ISE软件使用新建项目仿真
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实现设计
流程
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综合设计流程文本编辑器、图形编辑器VHDL综合器(逻辑综合、优化)FPGA/CPLD布线/适配器(自动优化、布局、布线、适配)VHDL仿真器(行为仿真、功能仿真、时序仿真)编程器/下载电缆(编程、下载)测试电路(硬件测试)网表文件(EDIF、XNL、VHDL…)门级仿真器(功能仿真、时序仿真)各种编程文件新建项目在桌面上单击XilinxISE9.1i进入项目管理器单击【File】【NewProject】如下图,填写项目名称、项目路径,然后单击【Next】如下图,选择目标器件,然后单击【Next】单击【Next】单击【Next】单击【Finish】单击【Project】【NewSource】如下图,选择源文件类型【VHDLModule】,填写源文件名称、路径然后单击【Next】如下图,填写输入输出端口名、端口模式、是否总线、总线的标号范围,然后单击【Next】进入文本编辑器在文本编辑器中输入源文件在Source窗口中选中需要处理的源文件,在Process窗口中双击Synthesize-XST。综合仿真如下图,单击【CreateNewSource】,选择源文件类型【VHDLTestBench】,填写源文件名称、路径然后单击【Next】如下图,选择与仿真测试文件所对应的源文件,然后单击【Next】在测试文件的tb进程中对输入信号进行赋值如下图,在Sourcefor中选择【BehavioralSimulation】如下图,在Processes窗口中双击【SimulateBehavioralModel】按下图选择【RunAll】,【Zoomout】【Zoommode】。然后观察波形。如下图,在Sourcefor选择【Synthesis/Implementation】设计实现如下图,在Sources窗口中选中源文件,在Processes窗口中双击UserConstraints下的【AssignPackagePins】单击【Yes】,创建ucf文件如下图,在LOC一列输入IO端口所对应的管脚号,并保存光标移至【GenerateProgramingFile】后单击鼠标右键,然后单击【Properties】.按下图所示进行选择。双击【GenerateProgramingFile】关闭该窗口双击【GenerateProm,ACE,orJTAGFile】双击【Finish】选择后缀为bit的文件,单击【Open】单击单击【Bypass】1、光标移至该图标,单击右键2、单击Program完成下载单击【Ok】下载成功。在开发板上观察结果。