四上升沿 D 触发器(有公共清除端) 54175/74175
54S175/74S175
54LS175/74LS175
简要说明
175 为四上升沿 D 触发器,共有 54175/74175、
54S175/74S175,54LS175/74LS175 三种线路结构形式。其主
要电特性的典型值如下:
型号 fm PD
54163/74163 35MHz 150mW
54S163/74S163 110MHz 300mW
54LS163/74LS163 40MHz 55mW
当清除端(CR)为低电平时,输出端 Q 为低电平。
在时钟(CP)上升沿作用下,Q 与数据端(D)相一致。
当 CP 为高电平或低电平时,D 对 Q 没有影响。
逻辑符号
引出端符号
CP 时钟输入端(上升沿有效)
CR 清除端(低电平有效)
1D~4D 数据输入端
1Q~4Q 输出端
1Q~4Q 互补输出端
极限值
电源电压 7V
输入电压
54/74175,54/74S175 5.5V
54/74LS175 7V
工作环境温度
54××× -55~125℃
74××× 0~70℃
储存温度 -65℃~150℃
功能表
H――高电平 L――低电平 �低到高跳变 X――任意 Z――高阻
Q0――规定的稳态输入条件建立前 Q 的电平
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推荐工作条件:
54/74175 54/74S175 54/74LS175 单位
最小 额定 最大 最小 额定 最大 最小 额定 最大
54 4.5 5 5.5 4.5 5 5.5 4.5 5 4.5 电源电压VCC
74 4.75 5 5.25 4.75 5 5.25 4.75 5 5.25
V
输入高电平电压ViH 2 2 2 V
54 0.8 0.8 0.7 输入低电平电压
ViL 74 0.8 0.8 0.8
V
输出高电平电流IOH -800 -1000 -400 uA
54 16 30 4 输出低电平电流IOL
74 16 30 8
mA
时钟频率 fcp 0 25 0 75 0 30 MHz
CP 20 7 25 ns 脉冲宽度TW
CR
20 10 20 ns
D 20 5 20 ns 建 立 时 间
tset
CR无效态
25 5 20 ns
保持时间 tH 5 3 0 ns
逻辑图
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静态特性(TA 为工作环境温度范围)
‘175 ‘S175 ‘LS175 单位
参 数 测 试 条 件【1】
最小 最大 最小 最大 最小 最大
Iik=-12mA -1.5
VIK输入嵌位电压 Vcc=最小
Iik=-18mA -1.2 -1.5
V
54 2.4 2.5 2.5
VOH输出高电平电压
Vcc=最小VIH =2V VIL
=最大, IOH=最大 74 2.4 2.7 2.7
V
54 0.4 0.5 0.4
VOL输出低电平电压
Vcc=最小,VIH=2V, VIL
=最大,IOL=最大 74 0.4 0.5 0.5
V
VI=5.5V 1 1 II最大输入电压时输入电
流
Vcc=最大
VI=7V 0.1
mA
VIH=2.4V 40
IIH输入高电平电流
Vcc=最大
VIH=2.7V 50 20
µA
VIL=0.4V -1.6 -0.4
IIL输入低电平电流 Vcc=最大,
VIL=0.5V -2
mA
54 -20 -57 -40 -100 -20 -100
IOS输出短路电流 Vcc=最大
74 -18 -57 -40 -100 -20 -100
mA
ICC电源电流
Vcc=最大,CP 瞬时接地后接
4.5V,所有 D 和CR 接 4.5V
45 96 18 mA
[1]: 测试条件中的“最小”和“最大”用推荐工作条件中的相应值。
动态特性(TA=25℃)
‘174 ‘S174 ‘LS174 参 数[2] 测 试 条 件
最小 最大 最小 最大 最小 最大
单位
fmax 25 75 30 MHz
tPLH 25 15 30 ns
tPHL
CR →任一 Q
35 22 30 ns
tPLH 30 12 25
tPHL
CP 任一 Q →
Vcc =5V,CL=15Pf,RL=400
Ω
(‘S175 为 280Ω,‘LS175
为 2KΩ)
35 17 25
ns
[2]: fmax 最大时钟频率。tPLH输出由低电平到高电平传输延迟时间 tPHL输出由高电平到低电平传输
延迟时间
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